十进制数（127.0625）10换算成二进制数，正确结果是（ ）。
A. （1011101.0011）2
B. （11101.101）2
C. （1111111.0001）2
【答案】：C
将二进制数（101011.101101）2转换成十进制数，正确结果是（ ）。
A. （43.703125）10
B. （44.839125）10
C. （45.839844）10
【答案】：A
将二进制数（100110.100111）2转换成十六进制数，正确结果是（ ）。
A. （92.97）16
B. （46.47）16
C. （26.9C）16
【答案】：C
经证明，等式（ ）正确。
A. img
B. img
C. img
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在下列真值表中，A、B为输入逻辑值，（ ）列的输出结果有误。
A
B
img img img
0
0
1
0
0
0
1
0
1
0
1
0
0
1
1
1
1
1
0
1
A. img
B. img
C. img
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题图所示电路能够实现（ ）逻辑关系。
img
A. 与
B. 与或非
C. 或
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对于TTL电路，0.7V的输入电压为（ ）输入。
A. 高电平
B. 低电平
C. 不能确定
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在门电路的电气特性中，将输出电压急剧上升或下降所对应的（ ）称为阈值电压。
A. 开启电压
B. 输入电压
C. 输出电压
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对于TTL电路，当本级门电路输出高电平时，输出端电流（ ）。
A. 不确定
B. 向外流出，电路带拉电流负载
C. 向内流入，电路带灌电流负载
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OC门“线与”连接并正常工作的前提是（ ）。
A. 电路输出端只需一个外接负载电阻
B. 电路输出端需要外接电源
C. 每个OC门分别接一个负载电阻
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题图所示逻辑电路逻辑关系是（ ）。
img
A. img
B. img
C. img
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将十进制小数转换成其他进制数时，应把小数部分乘以新进制的基数（如二进制的基数为2），把得到的整数部分作为新进制小数部分的最低位。（ ）
对
错
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逻辑函数可以用真值表、逻辑表达式和逻辑电路图来表示，也可以用卡诺图表示，但卡诺图与其他形式不能相互转换。（ ）
对
错
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波形图用于反映逻辑变量之间随时间变化的规律，能够方便直观地表现输入变量的逻辑关系。（ ）
对
错
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门电路的带负载能力用扇出系数表示，它通常由门电路输出低电平时的带负载能力决定。（ ）
对
错
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三态门是能够实现“线与”的逻辑门，当它处于高阻态时，输出端与电路连接断开。（ ）
对
错
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CMOS门电路在输入端和输出端的反相器，起到缓冲隔离和规范逻辑电平的作用。（ ）
对
错
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CMOS反相器的噪声容限大于TTL门电路的噪声容限，所以抗干扰能力也比TTL电路强。（ ）
对
错
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CMOS电路多余输入端不能悬空，TTL门电路的多余输入端可以悬空，悬空端相当于逻辑高电平。（ ）
对
错
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（1）根据题意列出真值表，正确结果为（ ）；
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
0
1
0
0
0
1
0
1
0
1
1
0
0
1
1
1
1
(a)
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
(b)
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
0
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
(c)
A. 真值表（c）
B. 真值表（b）
C. 真值表（a）
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（2）按最小项列出正确的逻辑表达式为（ ）；
A. img
B. img
C. img
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（3）正确是最简逻辑表达式为（ ）。
A. img
B. img
C. img
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（1）该电路为一个门电路连接较多门电路作为负载的结构形式，该电路应该优先选用（ ）；
A. CMOS门电路
B. TTL门电路
C. 两者均可
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（2）该电路以静态工作状态为主，若考虑功耗因素应选用（ ）。
A. 两者均可
B. TTL门电路
C. CMOS门电路
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（1）该电路最简与或形式的逻辑表达式是（ ）。
A. img
B. img
C. img
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（2）经分析，该电路具有（ ）功能。
A. 表决
B. 四舍五入
C. 单、双数判断
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由M进制集成计数器构成N进制计数器，当M＜N时一般采用清零法或置位法，当M＞N时则适合采用级联法。（ ）
对
错
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当D触发器的现态img时，为使每个CP脉冲该触发器翻转一次，D端应接至img。（ ）
对
错
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将主从JK触发器的J和K端都接低电平，则在时钟脉冲CP的作用下特性方程应为。img（ ）
对
错
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触发器虽然也是由门电路构成，但它与组合逻辑电路不同，具有逻辑状态的记忆功能。( )
对
错
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若系统中既有数字电路也有模拟电路，印刷电路板应分别设置接地线再合并接地。（ ）
对
错
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CMOS结构的组合逻辑越来越多被采用，是因为CMOS电路耗电量低。（ ）
对
错
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组合逻辑电路符合逻辑关系的最简电路形式不会发生竞争冒险现象。( )
对
错
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多位数值比较器在比较两个多位数的大小时，遵循先低位比较后高位的比较原则，只有在低位相等时，才需要比较高位。
对
错
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由RS触发器的真值表可知，它的状态方程和约束条件是（ ）。
R S 1063169
0
0
1063169
0
1
1
1
0
0
1
1
不允许
A. img
B. img
C. img
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N个触发器可以构成最大计数长度为( )的计数器。
A. N
B. 2N
C. N2
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与同步时序电路相比，异步时序电路的主要缺点是( )。
A. 抗干扰能力差
B. 功耗大
C. 速度慢
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为了把串行输入的数据转换成并行输出的数据，可以使用( )。
A. 移位寄存器
B. 计数器
C. 数据选择器
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由RS触发器的真值表可知，它的状态方程和约束条件是（ ）。
R S 1846263
0
0
1846263
0
1
1
1
0
0
1
1
不允许
A. img
B. img
C. img
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主从触发器在每个CP脉冲周期，( )。
A. 主触发器只能改变一次，但从触发器的输出状态可能改变多次
B. 主触发器的输出状态可能改变多次，但从触发器只能改变一次
C. 主触发器和从触发器的输出状态都只能改变一次
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由时序逻辑电路的功能特点可知，任意时刻触发器电路的输出状态( )。
A. 仅取决于电路的输入信号
B. 仅取决于现在的输出状态
C. 不仅取决于输入信号，还与输入信号作用前的现态有关
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下列三个逻辑电路框图中，（ ）是译码器。
img
A. 图a
B. 图b
C. 图c
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16选1数据选择器应该有( )个数据输入端。
A. 16
B. 4
C. 8
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三位同学按“少数服从多数”原则设计表决器逻辑电路，下列电路中（ ）是错误的。
img
A. 图（b）
B. 图（c）
C. 图（a）
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普通二进制编码器的输入变量中，任何时刻( )。
A. 均可多个被编对象有输入，但只对优先级别最高的进行编码
B. 均可多个被编对象有输入，它们共同确定编码结果
C. 仅有一个被编对象有输入，其他均没有输入
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下列消除竞争冒险的方法中，( )是错的。
A. 接入滤波电容
B. 在逻辑设计时增加冗余项
C. 引入时钟脉冲
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由组合逻辑电路的功能特点可知，任意时刻电路的输出( )。
A. 仅取决于该时刻的输入状态
B. 与该时刻输入状态和电路过去的输出状态均有关
C. 仅取决于电路过去的输出状态
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单稳态触发器与多谐振荡器在状态的区别是（ ）。
A. 前者没有稳态，后者有两个稳态
B. 前者没有稳态，后者只有一个稳态
C. 前者只有一个稳态，后者没有稳态
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石英晶体多谐振荡器的突出优点是（ ）。
A. 速度快
B. 价格便宜
C. 振荡频率稳定
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为了将正弦信号转换成脉冲信号，信号频率不变，可以采用（ ）。
A. 施密特触发器
B. 多谐振荡器
C. 单稳态触发器
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555定时器的阈值为（ ）。
A. img
B. img
C. img
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下列三种A/D转换器中，（ ）的转换速度最快。
A. 逐次比较型
B. 并行比较型
C. 双积分型
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某自动控制系统中，微机与执行部件之间的接口电路应采用（ ）。
A. D/A转换器
B. A/D转换器
C. 施密特触发器
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RAM是由存储矩阵、地址 ( )和读/写控制电路三部分组成的。
A. 分配器
B. 译码器
C. 编码器
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只能读出不能改写，信息可永久保存的半导体存储器是（ ）。
A. EPROM
B. ROM
C. PROM
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利用双稳态触发器存储信息的RAM称为（ ）。
A. DRAM
B. SRAM
C. 闪存
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某ROM电路有8根地址线，4根数据线，该ROM电路的容量为( )。
A. 512×4
B. 256×4
C. 1024×4
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下列PLD芯片中，与阵列、或阵列均为可编程的是( )器件。
A. PLA
B. PAL
C. GAL
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图2-6所示阵列逻辑电路的逻辑函数表达式是（ ）。
img
A. img
B. img
C. img
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单稳态触发器的输出脉冲宽度仅取决于电路本身的充放电时间参数，而与输入触发脉冲无关。( )
对
错
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多谐振荡器不需要外加输入信号，只要接通电源就能通过自激产生振荡波形，所以它也是一种正弦波振荡器。( )
对
错
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555定时器是一种用途极广泛的集成电路，包括双极型和CMOS型产品的所有型号最后三位数码都是555，外部引脚的排列完全相同。( )
对
错
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D/A转换器的转换精度与电阻网络的元件参数误差有关，与基准电压的稳定性无关。( )
对
错
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若逐次逼近型A/D转换器的输出为n位数字量，进行一次A/D转换至少需要经过n+2个CP周期才能完成。( )
对
错
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A/D转换器的相对误差≤±LSB/2，表明实际输出的数字量与理论值的误差小于最低位的半个字。( )
对
错
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RAM是由存储矩阵和地址译码器两部分组成的。( )
对
错
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SRAM是利用MOS管栅极电容存储电荷效应的半导体存储器。( )
对
错
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用4片256×4位RAM芯片，可扩展成512×8位的RAM存储系统。( )
对
错
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PAL器件中，与阵列和或阵列是电路的核心，不同的芯片输出结构差异很大。( )
对
错
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产品研制过程中需要不断修改的中、小规模逻辑电路，不适合选用GAL芯片。( )
对
错
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FPGA由可编程逻辑快、可编程I/O模块和可编程内连线三部分组成。( )
对
错
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时序图、状态转换图和状态转换表都可以用来描述一个时序逻辑电路的逻辑功能，它们可以相互转换。
对
错
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计数器的模是指构成计数器的触发器个数
对
错
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单稳态触发器的暂稳态时间与输入触发器脉冲宽度成正比
对
错
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对于边沿JK触发器，在CP为高电平期间，当J=K=1时，状态会翻转依次
对
错
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CMOS电路多余输入端（ ）。
A. 不能悬空
B. 能悬空
C. 不确定
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采用奇偶校验电路可以发现代码传送过程中的所有错误
对
错
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在数字电路中，逻辑功能相同的TTL门和CMOS门芯片可以相互替换使用
对
错
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时钟触发器仅当有时钟脉冲作用时，输入信号才能对触发器的状态产生影响
对
错
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用或非门可以实现3种基本的逻辑运算
对
错
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三极管饱和越深，关断时间越短
对
错
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单稳态触发器可以产生脉冲定时
对
错
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三态门除了输出高低电平之外，还有第三种输出状态，即高阻态
对
错
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TTL与非门的多余脚悬空等效于Vcc
对
错
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相同计数模的异步计数器和同步计数器相比，一般情况下（）
A. 驱动方式简单
B. 使用的触发器个数少
C. 工作速度快
D. 以上说法都不对
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n级触发器构成的环形计数器，其有效循环的状态数为
A. 2n+1个
B. 2n-1个
C. n个
D. 2n个
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要使T触发器Qn+1=Qn，则（）
A. T=0
B. T=QN
C. T=1
D. T=1或0
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一个4位二进制计数器的最大模数是
A. 8
B. 32
C. 4
D. 16
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触发器有两个稳态，存储8位二进制信息要（）个触发器
A. 16
B. 8
C. 4
D. 32
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在A/D转换器和D/A转换器中，衡量转换精度通常用（ ）。
A. 分辨率
B. 转换误差
C. 分辨率和转换误差
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74LS160十进制计数器含有的触发器个数是
A. 2
B. 4
C. 8
D. 1
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要构成容量为4K*8的RAM，需要（）片容量为256*4的RAM
A. 8
B. 32
C. 16
D. 4
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用异步I/O输出结构的PAL设计逻辑电路，它们相当于
A. 数模转换器
B. 存储器
C. 组合逻辑电路
D. 时序逻辑电路
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由与非门构成的基本RS触发器，要使Qn+1=Qn,则输入信号应为
A. R=S=1
B. R=1,S=0
C. R=0,S=1
D. R=S=0
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16选1数据选择器的地址端有（）位
A. 1
B. 4
C. 8
D. 2
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TTL反向器的阈值电压VTH为
A. 5V
B. 3.8V
C. 9V
D. 1.4V
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若CMOS反向器的VDD=10V,其阈值电压VTH为
A. 5V
B. 3.8V
C. 1.4V
D. 9V
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三态输出门在普通门电路输出状态的基础上增加的状态为
A. 高阻态
B. 高电平
C. 低阻态
D. 低电平
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由RS触发器的真值表可知，它的状态方程和约束条件是（ ）。
R S 1859617
0
0
1859617
0
1
1
1
0
0
1
1
不允许
A. img
B. img
C. img
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分析图2-4所示电路的逻辑功能。在下列选项中选择正确答案填入空内。
img
（1）该电路使用的触发器是（ ）。
A. 下降沿触发的边沿JK触发器
B. 上升沿触发的边沿JK触发器
C. 主从JK触发器
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（2）分析可知，该电路为（ ）。
img
A. 状态图如图2-5（b）所示，能自启动五进制同步计数器，
B. 状态图如图2-5（a）所示，不能自启动五进制同步计数器，
C. 状态图如图2-5（c）所示，能自启动六进制同步计数器，
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（3）在CP脉冲的作用下，该电路时序图为（ ）。
img
A. 图2-6（a）
B. 图2-6（c）
C. 图2-6（b）
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